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GitHub 2026-02-03 Trending

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SystemVerilog
Data collection date: 2026-02-03
SystemVerilog
Total 10 projects，sorted by Star Increment Sort
一款强大且可定制的macOS多排扩展坞替代品。将应用组织成多个部分，切换工作区，并自定义一切。
DockMaster Pro 是一款 macOS Dock 栏增强工具，目标是将原生 Dock 从「应用启动器」升级为「生产力中枢」。

adam-maj/tiny-gpu

SystemVerilog
连续上榜 7 天 累计上榜 151 次 星标飙升

一个用Verilog编写的极简GPU设计，用于从零开始学习GPU工作原理

adam-maj
adam-maj Developer
11k
950
580
+25
Ranking #8
2月3日
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hughperkins/VeriGPU

SystemVerilog
历史最高 #3 排名上升 ↑5

基于RISC-V指令集架构的开源GPU设计，采用Verilog实现

asic-design gpu gpu-acceleration
hughperkins
hughperkins Developer
1.2k
135
525
+7
Ranking #3
2月3日
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verilator/verilator

SystemVerilog
连续上榜 19 天 历史最高 #1 累计上榜 174 次 星标飙升

Verilator开源SystemVerilog模拟器与代码检查系统

compilers cpp rtl
verilator
verilator Developer
3.3k
749
557
+7
Ranking #1
2月3日
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pulp-platform/axi

SystemVerilog
累计上榜 87 次 星标飙升

用于高性能片上通信的AXI SystemVerilog可综合IP模块与验证框架。

asic axi axi4
pulp-platform
pulp-platform Developer
1.5k
339
579
+3
Ranking #9
2月3日
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lowRISC/ibex

SystemVerilog
连续上榜 17 天 霸榜 6 天 累计上榜 167 次 星标飙升

Ibex是一款小型32位RISC-V CPU内核，前身为zero-riscy

cpucore hardware risc-v
lowRISC
lowRISC Developer
1.8k
684
695
+2
Ranking #5
2月3日
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openhwgroup/cvw

SystemVerilog
连续上榜 3 天 累计上榜 42 次 排名上升 ↑5

CORE-V Wally是一款可配置的RISC-V处理器，与《RISC-V片上系统设计》教材相关联。

openhwgroup
openhwgroup Developer
484
377
237
+1
Ranking #2
2月3日
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chipsalliance/caliptra-rtl

SystemVerilog
连续上榜 13 天 霸榜 5 天 累计上榜 136 次

Caliptra可信根IP的硬件设计配套资源

chipsalliance
chipsalliance Developer
127
75
379
Ranking #10
2月3日
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aws/aws-fpga

SystemVerilog
累计上榜 55 次

AWS EC2 FPGA硬件与软件开发工具包的官方代码库

aws
aws Developer
1.6k
533
580
Ranking #7
2月3日
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pulp-platform/apb

SystemVerilog
累计上榜 54 次

APB总线逻辑

pulp-platform
pulp-platform Developer
23
20
182
Ranking #6
2月3日
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lowRISC/opentitan

SystemVerilog
连续上榜 6 天 霸榜 11 天 累计上榜 170 次

OpenTitan：开源硅基可信根

lowRISC
lowRISC Developer
3.1k
946
728
Ranking #4
2月3日
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