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GitHub 2026-02-12 Trending

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SystemVerilog
Data collection date: 2026-02-12
SystemVerilog
Total 8 projects，sorted by Star Increment Sort
一款强大且可定制的macOS多排扩展坞替代品。将应用组织成多个部分，切换工作区，并自定义一切。
DockMaster Pro 是一款 macOS Dock 栏增强工具，目标是将原生 Dock 从「应用启动器」升级为「生产力中枢」。

adam-maj/tiny-gpu

SystemVerilog
时隔 16 天回归 历史最高 #1 累计上榜 145 次 星标飙升 排名上升 ↑5

一个用Verilog编写的极简GPU设计，用于从零开始学习GPU工作原理

adam-maj
adam-maj Developer
11k
990
503
+18
Ranking #1
2月12日
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verilator/verilator

SystemVerilog
连续上榜 13 天 累计上榜 168 次 星标飙升

Verilator开源SystemVerilog模拟器与代码检查系统

compilers cpp rtl
verilator
verilator Developer
3.4k
751
497
+4
Ranking #4
2月12日
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lowRISC/opentitan

SystemVerilog
霸榜 6 天 累计上榜 165 次

OpenTitan：开源硅基可信根

lowRISC
lowRISC Developer
3.1k
952
631
+1
Ranking #2
2月12日
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aws/aws-fpga

SystemVerilog
累计上榜 55 次

AWS EC2 FPGA硬件与软件开发工具包的官方代码库

aws
aws Developer
1.6k
535
506
Ranking #8
2月12日
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openhwgroup/cv32e40p

SystemVerilog
累计上榜 26 次

CV32E40P is an in-order 4-stage RISC-V RV32IMFCXpulp CPU based on RI5CY from PULP-Platform

riscv riscv32imfc
openhwgroup
openhwgroup Developer
1.2k
501
476
Ranking #7
2月12日
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lowRISC/ibex

SystemVerilog
连续上榜 11 天 累计上榜 161 次

Ibex是一款小型32位RISC-V CPU内核，前身为zero-riscy

cpucore hardware risc-v
lowRISC
lowRISC Developer
1.8k
686
628
Ranking #6
2月12日
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chipsalliance/caliptra-rtl

SystemVerilog
连续上榜 8 天 时隔 19 天回归 累计上榜 131 次

Caliptra可信根IP的硬件设计配套资源

chipsalliance
chipsalliance Developer
128
75
332
Ranking #5
2月12日
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chipsalliance/Cores-VeeR-EL2

SystemVerilog
累计上榜 77 次 排名上升 ↑9

VeeR EL2处理器内核

ahb-lite asic-design axi4
chipsalliance
chipsalliance Developer
317
96
480
Ranking #3
2月12日
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