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SystemVerilog
Data collection date: 2026-03-02
SystemVerilog
Total 8 projects，sorted by Star Increment Sort
一款强大且可定制的macOS多排扩展坞替代品。将应用组织成多个部分，切换工作区，并自定义一切。
DockMaster Pro 是一款 macOS Dock 栏增强工具，目标是将原生 Dock 从「应用启动器」升级为「生产力中枢」。

lowRISC/ibex

SystemVerilog
连续上榜 9 天 霸榜 6 天 累计上榜 91 次 星标飙升

Ibex是一款小型32位RISC-V CPU内核，前身为zero-riscy

cpucore hardware risc-v
lowRISC
lowRISC Developer
1.8k
697
349
+2
Ranking #6
3月2日
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lowRISC/opentitan

SystemVerilog
连续上榜 9 天 历史最高 #1 累计上榜 86 次 排名飙升 ↑12

OpenTitan：开源硅基可信根

lowRISC
lowRISC Developer
3.2k
963
338
+1
Ranking #1
3月2日
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verilator/verilator

SystemVerilog
连续上榜 8 天 累计上榜 91 次 排名上升 ↑8

Verilator开源SystemVerilog模拟器与代码检查系统

compilers cpp rtl
verilator
verilator Developer
3.4k
764
300
Ranking #3
3月2日
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openhwgroup/cvfpu

SystemVerilog
连续上榜 8 天 累计上榜 67 次

支持标准RISC-V格式与运算及跨精度格式的参数化浮点运算单元。

openhwgroup
openhwgroup Developer
570
148
199
Ranking #4
3月2日
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pulp-platform/riscv-dbg

SystemVerilog
连续上榜 8 天 累计上榜 55 次

为PULP RISC-V内核提供的RISC-V调试支持

debug riscv
pulp-platform
pulp-platform Developer
297
91
229
Ranking #8
3月2日
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pulp-platform/tech_cells_generic

SystemVerilog
累计上榜 23 次

设计中针对通用流程实例化的工艺相关单元

pulp-platform
pulp-platform Developer
83
40
121
Ranking #7
3月2日
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pulp-platform/axi_mem_if

SystemVerilog
连续上榜 5 天 历史最高 #2 累计上榜 41 次 排名飙升 ↑10

简易单端口AXI存储器接口

asic axi fpga
pulp-platform
pulp-platform Developer
49
28
249
Ranking #2
3月2日
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pulp-platform/fpu_div_sqrt_mvp

SystemVerilog
连续上榜 9 天 累计上榜 78 次

面向跨精度计算的浮点除法/平方根运算单元

pulp-platform
pulp-platform Developer
26
17
184
Ranking #5
3月2日
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