GitHub 2026-03-03 Trending
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Data collection date:
2026-03-03
SystemVerilog
Total 8 projects，sorted by
Star Increment Sort
adam-maj/tiny-gpu
连续上榜 3 天
累计上榜 78 次
一个用Verilog编写的极简GPU设计，用于从零开始学习GPU工作原理
11k
1.1k
241
+14
lowRISC/opentitan
连续上榜 9 天
历史最高 #1
累计上榜 86 次
星标飙升
排名飙升 ↑12
OpenTitan：开源硅基可信根
3.2k
962
338
+4
verilator/verilator
连续上榜 8 天
累计上榜 91 次
星标飙升
排名上升 ↑8
Verilator开源SystemVerilog模拟器与代码检查系统
3.4k
764
300
+2
lowRISC/ibex
连续上榜 9 天
霸榜 6 天
累计上榜 91 次
星标飙升
Ibex是一款小型32位RISC-V CPU内核，前身为zero-riscy
1.8k
697
349
+2
openhwgroup/cvfpu
连续上榜 8 天
累计上榜 67 次
支持标准RISC-V格式与运算及跨精度格式的参数化浮点运算单元。
571
148
199
+1
chipsalliance/Cores-VeeR-EL2
累计上榜 56 次
排名飙升 ↑11
VeeR EL2处理器内核
320
98
251
pulp-platform/fpu_div_sqrt_mvp
连续上榜 9 天
累计上榜 78 次
面向跨精度计算的浮点除法/平方根运算单元
26
17
184
