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GitHub 2026-03-06 Trending

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SystemVerilog
Data collection date: 2026-03-06
SystemVerilog
Total 10 projects，sorted by Star Increment Sort
一款强大且可定制的macOS多排扩展坞替代品。将应用组织成多个部分，切换工作区，并自定义一切。
DockMaster Pro 是一款 macOS Dock 栏增强工具，目标是将原生 Dock 从「应用启动器」升级为「生产力中枢」。

lowRISC/opentitan

SystemVerilog
连续上榜 13 天 霸榜 24 天 历史最高 #1 累计上榜 134 次 星标飙升

OpenTitan：开源硅基可信根

lowRISC
lowRISC Developer
3.2k
965
525
+17
Ranking #1
3月6日
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black-parrot/black-parrot

SystemVerilog
星标飙升

面向全球且由全球共创的Linux兼容RISC-V多核处理器

black-parrot
black-parrot Developer
774
201
76
+3
Ranking #9
3月6日
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lowRISC/ibex

SystemVerilog
连续上榜 6 天 累计上榜 131 次 星标飙升

Ibex是一款小型32位RISC-V CPU内核，前身为zero-riscy

cpucore hardware risc-v
lowRISC
lowRISC Developer
1.8k
697
519
+2
Ranking #8
3月6日
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openhwgroup/cvfpu

SystemVerilog
累计上榜 91 次

支持标准RISC-V格式与运算及跨精度格式的参数化浮点运算单元。

openhwgroup
openhwgroup Developer
572
148
251
+1
Ranking #10
3月6日
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aws/aws-fpga

SystemVerilog
累计上榜 51 次

AWS EC2 FPGA硬件与软件开发工具包的官方代码库

aws
aws Developer
1.6k
537
417
+1
Ranking #7
3月6日
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chipsalliance/Cores-VeeR-EL2

SystemVerilog
累计上榜 61 次

VeeR EL2处理器内核

ahb-lite asic-design axi4
chipsalliance
chipsalliance Developer
321
98
399
+1
Ranking #6
3月6日
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chipsalliance/caliptra-rtl

SystemVerilog
连续上榜 6 天 累计上榜 105 次 排名上升 ↑8

Caliptra可信根IP的硬件设计配套资源

chipsalliance
chipsalliance Developer
132
81
276
+1
Ranking #3
3月6日
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bespoke-silicon-group/basejump_stl

SystemVerilog
时隔 14 天回归 累计上榜 26 次

BaseJump STL：SystemVerilog标准模板库

bespoke-silicon-group
bespoke-silicon-group Developer
649
113
151
Ranking #5
3月6日
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pulp-platform/axi

SystemVerilog
累计上榜 70 次

用于高性能片上通信的AXI SystemVerilog可综合IP模块与验证框架。

asic axi axi4
pulp-platform
pulp-platform Developer
1.5k
344
387
Ranking #4
3月6日
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verilator/verilator

SystemVerilog
连续上榜 5 天 累计上榜 137 次 排名飙升 ↑15

Verilator开源SystemVerilog模拟器与代码检查系统

compilers cpp rtl
verilator
verilator Developer
3.4k
768
378
Ranking #2
3月6日
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