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GitHub 2026-03-09 Trending

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SystemVerilog
Data collection date: 2026-03-09
SystemVerilog
Total 10 projects，sorted by Star Increment Sort
一款强大且可定制的macOS多排扩展坞替代品。将应用组织成多个部分，切换工作区，并自定义一切。
DockMaster Pro 是一款 macOS Dock 栏增强工具，目标是将原生 Dock 从「应用启动器」升级为「生产力中枢」。

verilator/verilator

SystemVerilog
历史最高 #1 累计上榜 144 次 星标飙升

Verilator开源SystemVerilog模拟器与代码检查系统

compilers cpp rtl
verilator
verilator Developer
3.4k
770
400
+8
Ranking #1
3月9日
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lowRISC/opentitan

SystemVerilog
连续上榜 22 天 霸榜 8 天 累计上榜 143 次

OpenTitan：开源硅基可信根

lowRISC
lowRISC Developer
3.2k
966
532
+5
Ranking #9
3月9日
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lowRISC/ibex

SystemVerilog
累计上榜 139 次

Ibex是一款小型32位RISC-V CPU内核，前身为zero-riscy

cpucore hardware risc-v
lowRISC
lowRISC Developer
1.8k
700
528
+3
Ranking #10
3月9日
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pulp-platform/axi

SystemVerilog
累计上榜 74 次 排名上升 ↑7

用于高性能片上通信的AXI SystemVerilog可综合IP模块与验证框架。

asic axi axi4
pulp-platform
pulp-platform Developer
1.5k
347
402
+3
Ranking #3
3月9日
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openhwgroup/cvfpu

SystemVerilog
累计上榜 97 次

支持标准RISC-V格式与运算及跨精度格式的参数化浮点运算单元。

openhwgroup
openhwgroup Developer
574
148
290
+2
Ranking #4
3月9日
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chipsalliance/adams-bridge

SystemVerilog
连续上榜 6 天 时隔 46 天回归 累计上榜 31 次

后量子密码学IP核（Crystals-Dilithium算法）

cryptography digital-signature lattice
chipsalliance
chipsalliance Developer
46
11
338
Ranking #8
3月9日
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chipsalliance/caliptra-ss

SystemVerilog
时隔 14 天回归 累计上榜 84 次

Caliptra子系统硬件设计资料，包含Caliptra可信根IP及附加制造商控制模块

caliptra ocp opencomputeproject
chipsalliance
chipsalliance Developer
39
37
308
Ranking #7
3月9日
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pulp-platform/common_cells

SystemVerilog
累计上榜 97 次 排名飙升 ↑13

通用SystemVerilog组件

pulp-platform
pulp-platform Developer
719
193
273
Ranking #6
3月9日
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chipsalliance/caliptra-rtl

SystemVerilog
连续上榜 8 天 时隔 16 天回归 累计上榜 113 次

Caliptra可信根IP的硬件设计配套资源

chipsalliance
chipsalliance Developer
133
82
292
Ranking #5
3月9日
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pulp-platform/fpu_div_sqrt_mvp

SystemVerilog
累计上榜 102 次 排名飙升 ↑11

面向跨精度计算的浮点除法/平方根运算单元

pulp-platform
pulp-platform Developer
26
17
261
Ranking #2
3月9日
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