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SystemVerilog
Data collection date: 2026-03-11
SystemVerilog
Total 14 projects,sorted by Star Increment Sort

adam-maj/tiny-gpu

连续上榜 5 天 累计上榜 80 次

一个用Verilog编写的极简GPU设计,用于从零开始学习GPU工作原理

11k
1.1k
243
+14
Ranking #10
3月11日
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lowRISC/opentitan

连续上榜 11 天 累计上榜 88 次 快速上升

OpenTitan:开源硅基可信根

3.2k
967
346
+5
Ranking #8
3月11日
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verilator/verilator

连续上榜 10 天 累计上榜 93 次 星标飙升

Verilator开源SystemVerilog模拟器与代码检查系统

3.4k
771
302
+4
Ranking #5
3月11日
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black-parrot/black-parrot

历史最高 #2 星标飙升 排名上升 ↑8

面向全球且由全球共创的Linux兼容RISC-V多核处理器

778
205
69
+2
Ranking #2
3月11日
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pulp-platform/common_cells

连续上榜 10 天 累计上榜 65 次

通用SystemVerilog组件

722
193
218
+1
Ranking #12
3月11日
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pulp-platform/fpu_div_sqrt_mvp

连续上榜 11 天 累计上榜 80 次

面向跨精度计算的浮点除法/平方根运算单元

27
17
198
+1
Ranking #9
3月11日
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lowRISC/ibex

连续上榜 11 天 霸榜 8 天 历史最高 #1 累计上榜 93 次

Ibex是一款小型32位RISC-V CPU内核,前身为zero-riscy

1.8k
701
350
+1
Ranking #1
3月11日
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chipsalliance/Cores-VeeR-EL2

累计上榜 56 次

VeeR EL2处理器内核

321
98
254
Ranking #14
3月11日
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openhwgroup/cvfpu

连续上榜 10 天 累计上榜 69 次

支持标准RISC-V格式与运算及跨精度格式的参数化浮点运算单元。

574
148
201
Ranking #13
3月11日
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pulp-platform/riscv-dbg

连续上榜 9 天 累计上榜 56 次

为PULP RISC-V内核提供的RISC-V调试支持

301
91
230
Ranking #11
3月11日
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chipsalliance/caliptra-rtl

时隔 18 天回归 累计上榜 65 次

Caliptra可信根IP的硬件设计配套资源

133
82
184
Ranking #7
3月11日
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chipsalliance/caliptra-ss

霸榜 6 天 时隔 16 天回归 累计上榜 45 次

Caliptra子系统硬件设计资料,包含Caliptra可信根IP及附加制造商控制模块

39
37
197
Ranking #6
3月11日
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pulp-platform/croc

历史最高 #4

一款面向教育的PULP片上系统,易于理解与扩展,并提供完整的物理设计流程。

212
96
161
Ranking #4
3月11日
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pulp-platform/axi

连续上榜 4 天 累计上榜 55 次 排名飙升 ↑11

用于高性能片上通信的AXI SystemVerilog可综合IP模块与验证框架。

1.5k
349
256
Ranking #3
3月11日
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