项目竞品
共找到 20 个竞品chipsalliance/rocket-chip
Rocket Chip生成器
riscv-boom/riscv-boom
SonicBOOM:伯克利乱序执行机器
firesim/firesim
FireSim:具备本地与云端灵活性的快速便捷FPGA加速硬件仿真平台
chipsalliance/chisel
Chisel:一种现代硬件设计语言
OpenXiangShan/XiangShan
开源高性能RISC-V处理器
SpinalHDL/SpinalHDL
基于Scala的硬件描述语言
chipsalliance/Cores-VeeR-EL2
VeeR EL2处理器内核
ucb-bar/chiseltest
面向Chisel设计RTL的全功能测试与形式验证库
SpinalHDL/VexRiscv
一种对FPGA友好的32位RISC-V CPU实现
riscv/riscv-unified-db
该单仓库包含一个机器可读的 RISC-V 规范数据库以及工件生成工具。
ucb-bar/saturn-vectors
Chisel RISC-V 向量 0 实现
dani-garcia/vaultwarden
基于Rust编写的非官方Bitwarden兼容服务器(前身为bitwarden_rs)
raysan5/raylib
一个简单易用的库,用于享受电子游戏编程的乐趣。
simdjson/simdjson
每秒解析千兆字节级JSON数据:被Facebook/Meta Velox、Node.js运行时、ClickHouse、WatermelonDB、Apache Doris、Milvus、StarRocks采用。
RT-Thread/rt-thread
RT-Thread 是一款开源的物联网实时操作系统(RTOS)。https://rt-thread.github.io/rt-thread/
k2-fsa/sherpa-onnx
基于新一代Kaldi与onnxruntime的离线语音转文字、文字转语音、说话人日志、语音增强、源分离及语音活动检测技术。支持嵌入式系统、Android、iOS、HarmonyOS、树莓派、RISC-V架构、x86_64服务器、WebSocket服务端/客户端,兼容12种编程语言。
verilator/verilator
Verilator开源SystemVerilog模拟器与代码检查系统
openhwgroup/cva6
CORE-V CVA6是高度可配置的6级RISC-V处理器核心,适用于应用级和嵌入式场景,应用级配置支持启动Linux
diku-dk/futhark
💥💻💥 一种数据并行的函数式编程语言
uxmal/reko
Reko是一个二进制反编译器。
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scala/scala
Scala 2编译器与标准库。Scala 2错误报告请提交至https://github.com/scala/bug;Scala 3项目位于https://github.com/scala/scala3
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一个用于构建和运行具备弹性、敏捷性和韧性应用的平台。提供软件开发工具包、程序库及托管环境。
akka/akka
一个用于构建和运行具备弹性、敏捷性和韧性应用的平台。提供SDK、库及托管环境。