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#hardware 每日趋势报告

📅 2026-03-30
📊 2 个项目

🔥 #hardware 每日热门项目

pulp-platform/axi

SystemVerilog

用于高性能片上通信的AXI SystemVerilog可综合IP模块与验证框架。

asic axi axi4
pulp-platform
pulp-platform 开发者
1.5k
352
189
+3
排名 #12
3月30日
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lowRISC/ibex

SystemVerilog

Ibex是一款小型32位RISC-V CPU内核，前身为zero-riscy

cpucore hardware risc-v
lowRISC
lowRISC 开发者
1.8k
707
266
+1
排名 #5
3月30日
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