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GitHub 2026-07-14 趋势

发现每日最热门的开源项目

2026-07-14
SystemVerilog
数据采集日期: 2026-07-14
SystemVerilog
共 7 个项目，按照 Star 增量 排序
一款强大且可定制的macOS多排扩展坞替代品。将应用组织成多个部分，切换工作区，并自定义一切。
DockMaster Pro 是一款 macOS Dock 栏增强工具，目标是将原生 Dock 从「应用启动器」升级为「生产力中枢」。

adam-maj/tiny-gpu

SystemVerilog
时隔 14 天回归 累计上榜 146 次 星标飙升

一个用Verilog编写的极简GPU设计，用于从零开始学习GPU工作原理

adam-maj
adam-maj 开发者
12k
1.2k
504
+15
排名 #5
7月14日
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lowRISC/ibex

SystemVerilog
连续上榜 12 天 时隔 15 天回归 累计上榜 162 次 星标飙升 排名上升 ↑6

Ibex是一款小型32位RISC-V CPU内核，前身为zero-riscy

cpucore hardware risc-v
lowRISC
lowRISC 开发者
2k
771
636
+6
排名 #2
7月14日
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lowRISC/opentitan

SystemVerilog
霸榜 7 天 时隔 15 天回归 历史最高 #1 累计上榜 166 次

OpenTitan：开源硅基可信根

lowRISC
lowRISC 开发者
3.5k
1.1k
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排名 #1
7月14日
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verilator/verilator

SystemVerilog
连续上榜 14 天 时隔 15 天回归 累计上榜 169 次

Verilator开源SystemVerilog模拟器与代码检查系统

compilers cpp rtl
verilator
verilator 开发者
3.7k
852
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排名 #3
7月14日
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pulp-platform/riscv-dbg

SystemVerilog
时隔 32 天回归 累计上榜 86 次

为PULP RISC-V内核提供的RISC-V调试支持

debug riscv
pulp-platform
pulp-platform 开发者
316
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428
排名 #7
7月14日
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pulp-platform/register_interface

SystemVerilog
时隔 32 天回归 累计上榜 34 次

通用寄存器接口（包含多种适配器）

pulp-platform
pulp-platform 开发者
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37
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排名 #6
7月14日
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chipsalliance/caliptra-rtl

SystemVerilog
连续上榜 9 天 时隔 14 天回归 累计上榜 132 次

Caliptra可信根IP的硬件设计配套资源

chipsalliance
chipsalliance 开发者
145
97
336
排名 #4
7月14日
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