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GitHub 2026-05-04 趋势
发现每日最热门的开源项目
数据采集日期:
2026-05-04
SystemVerilog
共 9 个项目,按照
Star 增量 排序
verilator/verilator
连续上榜 18 天
霸榜 5 天
累计上榜 127 次
Verilator开源SystemVerilog模拟器与代码检查系统
3.6k
807
370
+2
lowRISC/ibex
连续上榜 3 天
累计上榜 123 次
排名上升 ↑5
Ibex是一款小型32位RISC-V CPU内核,前身为zero-riscy
1.9k
728
480
+1
pulp-platform/register_interface
连续上榜 3 天
历史最高 #2
累计上榜 20 次
排名上升 ↑6
通用寄存器接口(包含多种适配器)
139
33
46
+1
pulp-platform/riscv-dbg
连续上榜 6 天
累计上榜 73 次
排名上升 ↑5
为PULP RISC-V内核提供的RISC-V调试支持
308
92
288