pulp-platform

pulp-platform/axi_mem_if

SystemVerilog 不活跃
69
2026-02-11
49
+0
#14
28

项目简介

简易单端口AXI存储器接口

Simple single-port AXI memory interface

智能解读

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智能标签

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使用场景

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项目健康度

25
D 较差

综合活跃度、人气、增长、社区、文档评估

活跃度
2/25
人气
10/25
增长
5/20
社区
3/15
文档
5/15
在 GitHub 上查看

项目信息

作者 pulp-platform
来源 GitHub
周期 每日
仓库 ID pulp-platform/axi_mem_if
最新提交 2024-06-07 11:45:22
首次采集 2026-02-12 08:01:56
最后更新 2026-02-12 08:06:16

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