pulp-platform

pulp-platform/axi_mem_if

SystemVerilog 不活跃
183
2026-04-08
49
+0
#12
29

项目介绍

简易单端口AXI存储器接口

Simple single-port AXI memory interface

智能解读

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项目健康度

F
17/100
不佳
活跃度人气增长社区文档
活跃度 0/23

距上次更新 673 天

人气 3/25

平台 Star TOP 98% · Forks 29

增长 2/25

暂无近期增长数据

社区 7/17

8 位贡献者 · 0 条平台评论

文档 5/10

缺少 3 项内容

3 项改进建议
  • 活跃度:项目已超过 673 天未更新,可能处于低维护状态
  • 人气:项目在平台内知名度较低,持续更新有助于提升曝光
  • 增长:近期 Star 增长缓慢,项目热度有待提升
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项目信息

作者 pulp-platform
来源 GitHub
周期 每日
仓库ID pulp-platform/axi_mem_if
最新提交 2024-06-07 11:45:22
第一收录 2026-04-09 10:13:57
最后更新 2026-04-09 10:15:17

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