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GitHub 2026-05-15 趋势

发现每日最热门的开源项目

2026-05-15
SystemVerilog
数据采集日期: 2026-05-15
SystemVerilog
共 8 个项目，按照 Star 增量 排序
一款强大且可定制的macOS多排扩展坞替代品。将应用组织成多个部分，切换工作区，并自定义一切。
DockMaster Pro 是一款 macOS Dock 栏增强工具，目标是将原生 Dock 从「应用启动器」升级为「生产力中枢」。

adam-maj/tiny-gpu

SystemVerilog
连续上榜 9 天 时隔 15 天回归 累计上榜 110 次

一个用Verilog编写的极简GPU设计，用于从零开始学习GPU工作原理

adam-maj
adam-maj 开发者
12k
1.2k
310
+8
排名 #6
5月15日
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lowRISC/opentitan

SystemVerilog
霸榜 13 天 时隔 15 天回归 历史最高 #1 累计上榜 123 次

OpenTitan：开源硅基可信根

lowRISC
lowRISC 开发者
3.4k
1k
464
+3
排名 #1
5月15日
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verilator/verilator

SystemVerilog
连续上榜 18 天 霸榜 5 天 时隔 15 天回归 累计上榜 127 次

Verilator开源SystemVerilog模拟器与代码检查系统

compilers cpp rtl
verilator
verilator 开发者
3.6k
814
370
+2
排名 #2
5月15日
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openhwgroup/cvfpu

SystemVerilog
时隔 15 天回归 累计上榜 88 次

支持标准RISC-V格式与运算及跨精度格式的参数化浮点运算单元。

openhwgroup
openhwgroup 开发者
602
158
248
排名 #8
5月15日
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pulp-platform/axi_riscv_atomics

SystemVerilog

用于RISC-V原子操作的AXI适配器

pulp-platform
pulp-platform 开发者
66
23
30
排名 #7
5月15日
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lowRISC/ibex

SystemVerilog
连续上榜 3 天 时隔 15 天回归 累计上榜 123 次

Ibex是一款小型32位RISC-V CPU内核，前身为zero-riscy

cpucore hardware risc-v
lowRISC
lowRISC 开发者
1.9k
736
483
排名 #5
5月15日
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chipsalliance/caliptra-rtl

SystemVerilog
时隔 15 天回归 累计上榜 96 次

Caliptra可信根IP的硬件设计配套资源

chipsalliance
chipsalliance 开发者
138
87
239
排名 #4
5月15日
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chipsalliance/caliptra-ss

SystemVerilog
霸榜 7 天 时隔 15 天回归 累计上榜 72 次

Caliptra子系统硬件设计资料，包含Caliptra可信根IP及附加制造商控制模块

caliptra ocp opencomputeproject
chipsalliance
chipsalliance 开发者
43
43
262
排名 #3
5月15日
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