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#rtl 每日趋势报告

📅 2026-04-21
📊 2 个项目

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verilator/verilator

SystemVerilog

Verilator开源SystemVerilog模拟器与代码检查系统

compilers cpp rtl
verilator
verilator 开发者
3.6k
795
302
+2
排名 #4
4月21日
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ucb-bar/chipyard

Scala

一个敏捷的RISC-V SoC设计框架，包含顺序执行内核、乱序执行内核、加速器等组件

accelerators boom chip-generator
ucb-bar
ucb-bar 开发者
2.2k
850
307
排名 #14
4月21日
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