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#rtl 每日趋势报告

📅 2026-03-05
📊 6 个项目

🔥 #rtl 每日热门项目

ucb-bar/chipyard

Scala

一个敏捷的RISC-V SoC设计框架，包含顺序执行内核、乱序执行内核、加速器等组件

accelerators boom chip-generator
ucb-bar
ucb-bar 开发者
2.2k
823
219
+5
排名 #9
3月5日
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chipsalliance/chisel

Scala

Chisel：一种现代硬件设计语言

chip-generator chisel chisel3
chipsalliance
chipsalliance 开发者
4.6k
653
223
+2
排名 #13
3月5日
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verilator/verilator

SystemVerilog

Verilator开源SystemVerilog模拟器与代码检查系统

compilers cpp rtl
verilator
verilator 开发者
3.4k
768
234
+1
排名 #3
3月5日
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riscv-boom/riscv-boom

Scala

SonicBOOM：伯克利乱序执行机器

berkeley boom chisel
riscv-boom
riscv-boom 开发者
2.1k
484
205
+1
排名 #14
3月5日
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chipsalliance/Cores-VeeR-EL2

SystemVerilog

VeeR EL2处理器内核

ahb-lite asic-design axi4
chipsalliance
chipsalliance 开发者
320
98
200
排名 #6
3月5日
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SpinalHDL/SpinalHDL

Scala

基于Scala的硬件描述语言

fpga rtl scala
SpinalHDL
SpinalHDL 开发者
1.9k
369
190
排名 #17
3月5日
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📊 数据统计

6 个热门项目
2026-03-05 数据日期

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