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#rtl 每日趋势报告

📅 2026-03-08
📊 5 个项目

🔥 #rtl 每日热门项目

ucb-bar/chipyard

Scala

一个敏捷的RISC-V SoC设计框架，包含顺序执行内核、乱序执行内核、加速器等组件

accelerators boom chip-generator
ucb-bar
ucb-bar 开发者
2.2k
826
219
+1
排名 #19
3月8日
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chipsalliance/Cores-VeeR-EL2

SystemVerilog

VeeR EL2处理器内核

ahb-lite asic-design axi4
chipsalliance
chipsalliance 开发者
321
98
201
排名 #5
3月8日
查看详情

pulp-platform/axi

SystemVerilog

用于高性能片上通信的AXI SystemVerilog可综合IP模块与验证框架。

asic axi axi4
pulp-platform
pulp-platform 开发者
1.5k
345
189
排名 #10
3月8日
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chipsalliance/rocket-chip

Scala

Rocket Chip生成器

chip-generator chisel riscv
chipsalliance
chipsalliance 开发者
3.7k
1.2k
235
排名 #2
3月8日
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SpinalHDL/SpinalHDL

Scala

基于Scala的硬件描述语言

fpga rtl scala
SpinalHDL
SpinalHDL 开发者
1.9k
369
190
排名 #14
3月8日
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📊 数据统计

5 个热门项目
2026-03-08 数据日期

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