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#rtl 每日趋势报告

📅 2026-03-09
📊 3 个项目

🔥 #rtl 每日热门项目

verilator/verilator

SystemVerilog

Verilator开源SystemVerilog模拟器与代码检查系统

compilers cpp rtl
verilator
verilator 开发者
3.4k
770
237
+8
排名 #1
3月9日
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pulp-platform/axi

SystemVerilog

用于高性能片上通信的AXI SystemVerilog可综合IP模块与验证框架。

asic axi axi4
pulp-platform
pulp-platform 开发者
1.5k
347
189
+3
排名 #3
3月9日
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SpinalHDL/SpinalHDL

Scala

基于Scala的硬件描述语言

fpga rtl scala
SpinalHDL
SpinalHDL 开发者
1.9k
369
192
+2
排名 #10
3月9日
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📊 数据统计

3 个热门项目
2026-03-09 数据日期

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