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2026-03-29
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#rtl 每日趋势报告

📅 2026-03-29
📊 4 个项目

🔥 #rtl 每日热门项目

verilator/verilator

SystemVerilog

Verilator开源SystemVerilog模拟器与代码检查系统

compilers cpp rtl
verilator
verilator 开发者
3.5k
784
234
+4
排名 #4
3月29日
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pulp-platform/axi

SystemVerilog

用于高性能片上通信的AXI SystemVerilog可综合IP模块与验证框架。

asic axi axi4
pulp-platform
pulp-platform 开发者
1.5k
352
189
+1
排名 #5
3月29日
查看详情

ucb-bar/constellation

Scala

面向片上网络互连的Chisel硬件描述语言生成器

chisel hardware interconnect
ucb-bar
ucb-bar 开发者
227
38
89
排名 #4
3月29日
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ucb-bar/chipyard

Scala

一个敏捷的RISC-V SoC设计框架，包含顺序执行内核、乱序执行内核、加速器等组件

accelerators boom chip-generator
ucb-bar
ucb-bar 开发者
2.2k
839
218
排名 #16
3月29日
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📊 数据统计

4 个热门项目
2026-03-29 数据日期

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