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2026-04-01
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#rtl 每日趋势报告

📅 2026-04-01
📊 4 个项目

🔥 #rtl 每日热门项目

ucb-bar/chipyard

Scala

一个敏捷的RISC-V SoC设计框架，包含顺序执行内核、乱序执行内核、加速器等组件

accelerators boom chip-generator
ucb-bar
ucb-bar 开发者
2.2k
843
218
+5
排名 #12
4月1日
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verilator/verilator

SystemVerilog

Verilator开源SystemVerilog模拟器与代码检查系统

compilers cpp rtl
verilator
verilator 开发者
3.5k
788
234
+4
排名 #9
4月1日
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pulp-platform/axi

SystemVerilog

用于高性能片上通信的AXI SystemVerilog可综合IP模块与验证框架。

asic axi axi4
pulp-platform
pulp-platform 开发者
1.5k
352
189
排名 #3
4月1日
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chipsalliance/chisel

Scala

Chisel：一种现代硬件设计语言

chip-generator chisel chisel3
chipsalliance
chipsalliance 开发者
4.6k
651
222
排名 #19
4月1日
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📊 数据统计

4 个热门项目
2026-04-01 数据日期

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