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2026-07-16
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#rtl 每日趋势报告

📅 2026-07-16
📊 4 个项目

🔥 #rtl 每日热门项目

chipsalliance/chisel

Scala

Chisel：一种现代硬件设计语言

chip-generator chisel chisel3
chipsalliance
chipsalliance 开发者
4.7k
651
649
+2
排名 #23
7月16日
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verilator/verilator

SystemVerilog

Verilator开源SystemVerilog模拟器与代码检查系统

compilers cpp rtl
verilator
verilator 开发者
3.7k
852
518
+1
排名 #16
7月16日
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pulp-platform/axi

SystemVerilog

用于高性能片上通信的AXI SystemVerilog可综合IP模块与验证框架。

asic axi axi4
pulp-platform
pulp-platform 开发者
1.6k
360
552
排名 #7
7月16日
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chipsalliance/rocket-chip

Scala

Rocket Chip生成器

chip-generator chisel riscv
chipsalliance
chipsalliance 开发者
3.8k
1.3k
599
排名 #21
7月16日
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📊 数据统计

4 个热门项目
2026-07-16 数据日期

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