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#rtl 每日趋势报告

📅 2026-03-06
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🔥 #rtl 每日热门项目

chipsalliance/chisel

Chisel:一种现代硬件设计语言

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排名 #4
3月6日
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chipsalliance/Cores-VeeR-EL2

VeeR EL2处理器内核

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排名 #6
3月6日
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ucb-bar/chipyard

一个敏捷的RISC-V SoC设计框架,包含顺序执行内核、乱序执行内核、加速器等组件

2.2k
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排名 #21
3月6日
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verilator/verilator

Verilator开源SystemVerilog模拟器与代码检查系统

3.4k
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排名 #2
3月6日
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pulp-platform/axi

用于高性能片上通信的AXI SystemVerilog可综合IP模块与验证框架。

1.5k
344
189
排名 #4
3月6日
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